Un système de cache hiérarchique pour les E/S présentant des motifs séquentiels pour les mémoires flash NAND

Pierre Olivier 1 Jalil Boukhobza 1
1 Lab-STICC_UBO_CACS_MOCS
Lab-STICC - Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance, UBO - Université de Brest
Résumé : Les mémoires flash deviennent aujourd'hui le principal média de stockage dans l'informatique mobile, et tendent à être moins confinées à ce domaine. Les faibles performances en écriture font que cette technologie n'est pas assez mature pour une utilisation à grande échelle en entreprise. La contrainte majeure est le nombre limité d'effacements, provoquant l'usure rapide de la mémoire. Les algorithmes de gestion du phénomène d'usure, intégrés au sein de la FTL (Flash Translation Layer), contribuent grandement à la baisse de performance en écriture. Nous proposons d'augmenter les performances tout en réduisant l'usure en absorbant les effacements grâce à un système de cache, remplaçant la plupart des services FTL. Les évaluations expérimentales menées montrent que le cache améliore considérablement les performances par rapport aux FTL actuelles, réduisant de plus de 65 % le temps de réponse moyen et le nombre d'effacements pour certaines traces OLTP intensives en écriture.
Type de document :
Article dans une revue
Revue des Sciences et Technologies de l'Information - Série TSI : Technique et Science Informatiques, Lavoisier, 2013, 32 (2), pp.203-228. 〈10.3166/tsi.32.203-228〉
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http://hal.univ-brest.fr/hal-00818836
Contributeur : Jalil Boukhobza <>
Soumis le : lundi 29 avril 2013 - 13:01:22
Dernière modification le : mardi 16 janvier 2018 - 15:54:23

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Pierre Olivier, Jalil Boukhobza. Un système de cache hiérarchique pour les E/S présentant des motifs séquentiels pour les mémoires flash NAND. Revue des Sciences et Technologies de l'Information - Série TSI : Technique et Science Informatiques, Lavoisier, 2013, 32 (2), pp.203-228. 〈10.3166/tsi.32.203-228〉. 〈hal-00818836〉

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